| Title | 一种适用于多精度计算的可重构浮点乘加运算单元及方法 |
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| First Inventor | 谢歆昂
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| Original applicant | 南方科技大学
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| First applicant | 南方科技大学
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| Address of First applicant | 518055 广东省深圳市南山区学苑大道1088号南方科技大学
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| Current applicant | 南方科技大学
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| Address of Current applicant | 518055 广东省深圳市南山区学苑大道1088号南方科技大学 (广东,深圳,南山区)
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| First Current Applicant | 南方科技大学
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| Address of First Current Applicant | 518055 广东省深圳市南山区学苑大道1088号南方科技大学 (广东,深圳,南山区)
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| Application Number | CN202110178984.2
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| Application Date | 2021-02-09
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| Open (Notice) Number | CN112860220B
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| Date Available | 2023-03-24
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| Publication Years | 2023-03-24
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| Status of Patent | 授权
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| Legal Date | 2023-03-24
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| Subtype | 授权发明
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| SUSTech Authorship | First
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| Abstract | 本发明公开了一种适用于多精度计算的可重构浮点乘加运算单元及方法，通过采用统一的方法对不同精度的浮点的尾数进行划分，得到多个比特段，并调用不同数量的同一类单元乘法器在一个周期内实现多个比特段的乘法运算并输出对应的乘积，然后对所述乘积进行移位相加操作后即可得到浮点数的乘累加运算结果。本发明采用统一的尾数划分方案避免了比特冗余的问题，采用统一的单元乘法器提高了硬件利用率，还可以实现半精度浮点数的乘累加运算、单精度点积浮点数的乘累加运算和双精度浮点数的乘累加运算。解决了现有技术中支持多精度浮点乘法运算的运算方法会产生比特冗余、硬件利用率低等情况的问题。 |
| Other Abstract | 本发明公开了一种适用于多精度计算的可重构浮点乘加运算单元及方法，通过采用统一的方法对不同精度的浮点的尾数进行划分，得到多个比特段，并调用不同数量的同一类单元乘法器在一个周期内实现多个比特段的乘法运算并输出对应的乘积，然后对所述乘积进行移位相加操作后即可得到浮点数的乘累加运算结果。本发明采用统一的尾数划分方案避免了比特冗余的问题，采用统一的单元乘法器提高了硬件利用率，还可以实现半精度浮点数的乘累加运算、单精度点积浮点数的乘累加运算和双精度浮点数的乘累加运算。解决了现有技术中支持多精度浮点乘法运算的运算方法会产生比特冗余、硬件利用率低等情况的问题。 |
| IPC Classification Number | G06F7/575
; G06F7/523
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| INPADOC Legal Status | （+PATENT GRANT）[2023-03-24][CN]
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| INPADOC Patent Family Count | 2
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| Extended Patent Family Count | 2
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| Priority date | 2021-02-09
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| Patent Agent | 徐凯凯
; 谢松
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| Agency | 深圳市君胜知识产权代理事务所(普通合伙)
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| URL | [Source Record] |
| Data Source | PatSnap
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| Document Type | Patent |
| Identifier | http://kc.sustech.edu.cn/handle/2SGJ60CL/522609 |
| Department | Preparatory Office of SUSTech Institute of Microelectronics, SUSTech and HKUST 工学院_深港微电子学院 |
| Recommended Citation GB/T 7714 |
谢歆昂,李凯,李博宇,等. 一种适用于多精度计算的可重构浮点乘加运算单元及方法[P]. 2023-03-24.
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